.*: +file format .*arm.*
Disassembly of section .text:
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-0+2b6 <[^>]*> eeb8 fbe0 fsitodeq d15, s1
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-0+2be <[^>]*> eefd 0b4f ftosideq s1, d15
-0+2c2 <[^>]*> eefd fbc2 ftosizdeq s31, d2
+0+2b6 <[^>]*> eeb8 fbe0 (vcvteq\.f64\.s32|fsitodeq) d15, s1
+0+2ba <[^>]*> eeb8 1b6f (vcvteq\.f64\.u32|fuitodeq) d1, s31
+0+2be <[^>]*> eefd 0b4f (vcvtreq\.s32\.f64|ftosideq) s1, d15
+0+2c2 <[^>]*> eefd fbc2 (vcvteq\.s32\.f64|ftosizdeq) s31, d2
0+2c6 <[^>]*> bf01 itttt eq
-0+2c8 <[^>]*> eefc 7b42 ftouideq s15, d2
-0+2cc <[^>]*> eefc 5bc3 ftouizdeq s11, d3
-0+2d0 <[^>]*> eeb7 1ac5 fcvtdseq d1, s10
-0+2d4 <[^>]*> eef7 5bc1 fcvtsdeq s11, d1
+0+2c8 <[^>]*> eefc 7b42 (vcvtreq\.u32\.f64|ftouideq) s15, d2
+0+2cc <[^>]*> eefc 5bc3 (vcvteq\.u32\.f64|ftouizdeq) s11, d3
+0+2d0 <[^>]*> eeb7 1ac5 (vcvteq\.f64\.f32|fcvtdseq) d1, s10
+0+2d4 <[^>]*> eef7 5bc1 (vcvteq\.f32\.f64|fcvtsdeq) s11, d1
0+2d8 <[^>]*> bf01 itttt eq
0+2da <[^>]*> ee31 8b10 vmoveq\.32 r8, d1\[1\]
0+2de <[^>]*> ee1f 7b10 vmoveq\.32 r7, d15\[0\]
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